CMOS集成电路设计两级放大器手工计算部分
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发布时间：2022-04-21 22:43
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时间：2023-07-24 11:55
没人会跟你去弄网表的，现在都用cadence仿真了。这个只是纯学术交流：
（1）Stage 1 每条支路的电流为20 uA，但是你的输入管M1和M2宽长比只有2/1，这样会严重*你的输入电压范围。因为漏极电流定的情况下，W/L越小，Vg越大，这样会要求你的Vin的DC值很大。正常设计M1和M2 会比较大，10/1乃至20/1都可能有。且输入管一般是长条形状，这样layout比较好做match。
（2）M7的电流是175uA，是M4的8倍左右，一般而言，M6的宽长比也应该是M4的8倍，且L应该一致，这样stage1 和stage2 的输出电压DC值会一致。M4：W=12u L=4u， M6： W=12u L=4u Finger=8。
（3）关于输出摆率，主要是stage 2支路电流对输出电容进行充电，Imax/Ctotal=V/t=175u/6.5p=27 V/us， 之所以你仿真的值很小，个人怀疑你输出级的电流根本就没有175uA，或者你的仿真条件设置有误。仿真输出摆率时，输入电压Vin的rise time要小，1ps或者1ns。不然你输入变的慢，输出也自然慢了。
